{"id":2931,"date":"2005-10-03T09:13:56","date_gmt":"2005-10-03T08:13:56","guid":{"rendered":"https:\/\/www.prueba.local\/dsi-proyectos\/"},"modified":"2021-02-01T10:35:41","modified_gmt":"2021-02-01T10:35:41","slug":"dsi-proyectos","status":"publish","type":"post","link":"https:\/\/www.iuma.ulpgc.es\/en\/dsi-proyectos\/","title":{"rendered":"Divisi\u00f3n de Dise\u00f1o de Sistemas Integrados &#8211; Proyectos"},"content":{"rendered":"<p><\/p>\n<table class=\"divisiones\" cellspacing=\"0\" cellpadding=\"0\" width=\"20%\" align=\"center\" bgcolor=\"#0b4ab1\" border=\"0\">\n<tbody>\n<tr>\n<td width=\"24%\">\n<div class=\"divisiones\" align=\"center\"><a href=\"https:\/\/www.prueba.local\/dsi-presentaci\/\">Presentation<\/a><\/div>\n<\/td>\n<td width=\"22%\">\n<div class=\"divisiones\" align=\"center\"><a href=\"index.php?option=com_contact&#038;catid=23&#038;Itemid=109\">Members<\/a><\/div>\n<\/td>\n<td width=\"22%\">\n<div class=\"divisiones\" align=\"center\"><a href=\"https:\/\/www.prueba.local\/dsi-las-de-investigaci\/\">Research<\/a><\/div>\n<\/td>\n<td style=\"background-color: #0099ff\" width=\"32%\">\n<div style=\"color: #ff9017; background-color: #0099ff\" align=\"center\"><a style=\"border-top-style: none; border-right-style: none; border-left-style: none; border-bottom-style: none\" href=\"https:\/\/www.prueba.local\/?p=3\">Projects<\/a><\/div>\n<\/td>\n<\/tr>\n<\/tbody>\n<\/table>\n<p><\/p>\n<div align=\"center\"><a name=\"proyectos\"><\/a><font size=\"2\"><u><strong>Proyectos y convenios<\/strong><\/u><\/font><\/div>\n<p align=\"center\"><u><br \/><\/u><\/p>\n<p><u><\/p>\n<table cellspacing=\"5\" cellpadding=\"5\" width=\"100%\" border=\"0\">\n<tbody>\n<tr>\n<td width=\"75%\">\n<ul>\n<li><u>Proyecto GigaStream <\/u><\/li>\n<\/ul>\n<blockquote dir=\"ltr\" style=\"margin-right: 0px\">\n<div align=\"justify\">Desarrollo de un elemento de conmutaci\u00f3n CSX de alta velocidad con un ancho de banda agregado de hata 80 Gbps. Este proyecto, desarrollado para Vitesse Semiconductors Corp. (California) en colaboraci\u00f3n con empresas de EE.UU, Reino Unido e India esta formado por un chipset que incluye una matriz de conmutaci\u00f3n y un sistema de almacenamiento desarrollado este\u00faltimo entereamente en la DSI <\/div>\n<\/blockquote>\n<\/td>\n<td>\n<p align=\"center\"><img loading=\"lazy\" decoding=\"async\" height=\"143\" alt=\"\" src=\"images\/stories\/imagenes_iuma\/dsi\/dsi-gigastream.jpg\" width=\"173\" border=\"0\" \/><\/p>\n<\/td>\n<\/tr>\n<tr>\n<td>\n<ul>\n<li><u>Proyecto IPI200 <\/u><\/li>\n<\/ul>\n<blockquote dir=\"ltr\" style=\"margin-right: 0px\">\n<div align=\"justify\">Dise&ntilde;o de un procesador de im\u00e1genes para comunicaciones multimedia. Este proyecto, desarrollado para la empresa Intelligent Pixels Inc (Connecticut, EE.UU), e incorporado en productos comercialmente disponibles, est\u00e1 formado por un array de 144&#215;176 pixels e integra 15 millones de transistores formando una rede que ocupa un \u00e1rea de 15&#215;15 mm2. <\/div>\n<\/blockquote>\n<\/td>\n<td>\n<p align=\"center\"><img loading=\"lazy\" decoding=\"async\" height=\"145\" alt=\"\" src=\"images\/stories\/imagenes_iuma\/dsi\/dsi-ipi200.jpg\" width=\"176\" border=\"0\" \/><\/p>\n<\/td>\n<\/tr>\n<tr>\n<td>\n<ul>\n<li><u>Proyecto HSCHAR <\/u><\/li>\n<\/ul>\n<blockquote dir=\"ltr\" style=\"margin-right: 0px\">\n<div align=\"justify\">Desarrollo e implementaci\u00f3n de un sistema para la caracterizaci\u00f3n de circuitos integrados de conmutacions de paquetes en sistemas de alta velocidad. Este proyecto, realizado para la empresa Vitesse Semiconductor Corp. (California, EE.UU.), incluye el desarrollo de un entorno parametrizable para la medici\u00f3n autom\u00e1tica de las prestaciones del sistema. <\/div>\n<\/blockquote>\n<\/td>\n<td>\n<p align=\"center\"><img loading=\"lazy\" decoding=\"async\" height=\"142\" alt=\"\" src=\"images\/stories\/imagenes_iuma\/dsi\/dsi-hschar.jpg\" width=\"173\" border=\"0\" \/><\/p>\n<\/td>\n<\/tr>\n<tr>\n<td>\n<ul>\n<li><u>Proyecto VCS851 <\/u><\/li>\n<\/ul>\n<blockquote dir=\"ltr\" style=\"margin-right: 0px\">\n<div align=\"justify\">Desarrollo de una matrix de conmutaci\u00f3n as\u00edncrona de 32&#215;32 a 1.6Gbps. Este producto, realizado para la empresa Vitesse Semiconductor Corp. (California, EE.UU.), en un tiempo r&eacute;cord, tuvo gran &eacute;xito comercial debido a la mejoras de sus prestaciones con respecto a productos de similares caract&eacute;risticas disponibles en el mercado. <\/div>\n<\/blockquote>\n<\/td>\n<td>\n<p align=\"center\"><img loading=\"lazy\" decoding=\"async\" height=\"169\" alt=\"\" src=\"images\/stories\/imagenes_iuma\/dsi\/dsi-vcs851.jpg\" width=\"203\" border=\"0\" \/><\/p>\n<\/td>\n<\/tr>\n<tr>\n<td>\n<ul>\n<li><u>Proyecto INGENET <\/u><\/li>\n<\/ul>\n<blockquote dir=\"ltr\" style=\"margin-right: 0px\">\n<div align=\"justify\">INGENET es el mayor proyecto europeo de la DGXII para redes tem\u00e1ticas dentro del programa Brite-Euram con el objetivo de desarrollar el sector areoespacial europeo y su aplicaci\u00f3n aeron\u00e1utica, electromagn&eacute;tica, electr\u00f3nica, ac\u00fastica, as\u00ed como de control y autom\u00e1tica. En este proyecto participan multitud de institutos de investigaci\u00f3n y empresas europeas. <\/div>\n<\/blockquote>\n<\/td>\n<td>\n<p align=\"center\"><img loading=\"lazy\" decoding=\"async\" height=\"142\" alt=\"\" src=\"images\/stories\/imagenes_iuma\/dsi\/dsi-ingenet.jpg\" width=\"174\" border=\"0\" \/><\/p>\n<\/td>\n<\/tr>\n<tr>\n<td>\n<ul>\n<li>\n<div align=\"justify\"><u>Proyecto GARDEN <\/u><\/div>\n<\/li>\n<\/ul>\n<blockquote dir=\"ltr\" style=\"margin-right: 0px\">\n<div align=\"justify\">Proyecto correspondiente al Programa de Capital Humano y Movilidad de la Comunidad Europea para el desarrollo de un entorno de dise&ntilde;o de circuitos digitales de elevadas prestaciones en tecnolog\u00eda GaAs. La finalidad del proyecto, liderado por el IUMA, es la realizaci\u00f3n de herramientas de ayuda al dise&ntilde;o en GaAs. <\/div>\n<\/blockquote>\n<\/td>\n<td>\n<p align=\"center\"><img loading=\"lazy\" decoding=\"async\" height=\"136\" alt=\"\" src=\"images\/stories\/imagenes_iuma\/dsi\/dsi-garden.jpg\" width=\"173\" border=\"0\" \/><\/p>\n<\/td>\n<\/tr>\n<tr>\n<td>\n<ul>\n<li><u>Proyecto EDGAAS <\/u><\/li>\n<\/ul>\n<blockquote dir=\"ltr\" style=\"margin-right: 0px\">\n<div align=\"justify\">Proyecto financiado por la CICYT para el desarrollo de un entorno de dise&ntilde;o que permita la generaci\u00f3n de circuitos y sistemas para procesamiento digital de se&ntilde;ales. Entre los principales resultados obtenidos se incluye una librer\u00eda de unidades aritm&eacute;ticas y de memorias para el desarrollo de primitivas aceleradoras de hardware. <\/div>\n<\/blockquote>\n<\/td>\n<td>\n<p align=\"center\"><img loading=\"lazy\" decoding=\"async\" height=\"143\" alt=\"\" src=\"images\/stories\/imagenes_iuma\/dsi\/dsi-edgaas.jpg\" width=\"174\" border=\"0\" \/><\/p>\n<\/td>\n<\/tr>\n<tr>\n<td>\n<ul>\n<li><u>Proyecto GRAAS <\/u><\/li>\n<\/ul>\n<blockquote dir=\"ltr\" style=\"margin-right: 0px\">\n<p>Proyecto europeo de universidades y centros de investigaci\u00f3n relacionados con el dise&ntilde;o digital de circuitos y sistemas en GaAs financiado por la DGXII y coordinado por el IUMA. El objetivo principal del proyecto fue el desarrollo de un entorno para la s\u00edntesis de ASIC en GaAs , con especial &eacute;nfasis en el an\u00e1lisis de las prestaciones. <\/p>\n<\/blockquote>\n<\/td>\n<td>\n<p align=\"center\"><img loading=\"lazy\" decoding=\"async\" height=\"140\" alt=\"\" src=\"images\/stories\/imagenes_iuma\/dsi\/dsi-graas.jpg\" width=\"174\" border=\"0\" \/><\/p>\n<\/td>\n<\/tr>\n<\/tbody>\n<\/table>\n<p><\/u><\/p>","protected":false},"excerpt":{"rendered":"<p>Presentaci\u00f3n Miembros Investigaci\u00f3n Proyectos Proyectos y convenios Proyecto GigaStream Desarrollo de un elemento de conmutaci\u00f3n CSX de alta velocidad con un ancho de banda agregado de hata 80 Gbps. Este proyecto, desarrollado para Vitesse Semiconductors Corp. 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